Note FPU enable/disable issue.
[qemu] / target-mips / TODO
1 Unsolved issues/bugs in the mips/mipsel backend
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3
4 General
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6 - [ls][dw][lr] report broken (aligned) BadVAddr
7 - Missing per-CPU instruction decoding, currently all implemented
8   instructions are regarded as valid
9 - pcnet32 does not work for little endian emulation on big endian host
10   (probably not mips specific, but observable for mips-malta)
11 - CP1 enable/disable is checked at translation time, not at execution
12   time, so it will have delayed effect.
13
14 MIPS64
15 ------
16 - No 64bit TLB support
17 - no 64bit wide registers for FPU
18 - 64bit mul/div handling broken
19
20 "Generic" 4Kc system emulation
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22 - Doesn't correspond to any real hardware.
23
24 MALTA system emulation
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26 - We fake firmware support instead of doing the real thing
27 - Real firmware falls over when trying to init RAM, presumably due
28   to lacking I2C emulation.